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Programming Model Quick Reference
Table 6-18. Host-Side Registers After Reset (Continued)
Reset Type
Register
Register
Name
ISR
Data
HREQ
HW
Reset
0
SW
Reset
0
Individual Reset
1 if TREQ is set;
STOP
1 if TREQ is set;
0 otherwise
0 otherwise
HF3 -HF2
TRDY
TXDE
RXDF
0
1
1
0
0
1
1
0
—
1
1
0
—
1
1
0
IVR
RX
TX
IV[0–7]
RXH:RXM:RXL
TXH:TXM:TXL
$0F
empty
empty
$0F
empty
empty
—
empty
empty
—
empty
empty
Note:
A long dash (—) denotes that the bit value is not affected by the specified reset.
6.8 Programming Model Quick Reference
Table 6-19 summarizes the HI08 programming model.
Table 6-19. HI08 Programming Model, DSP Side
Bit
Reset Type
Register
HCR
Bit
No.
0
Bit
HRIE
Name
Receive Interrupt
Value
0
Function
HRRQ interrupt disabled
HW/
SW
0
Indivi-
dual
—
STOP
—
Enable
1
HRRQ interrupt enabled
1
HTIE
Transmit
0
HTRQ interrupt disabled
0
—
—
Interrupt Enable
1
HTRQ interrupt enabled
2
HCIE
Host Command
0
HCP interrupt disabled
0
—
—
Interrupt Enable
1
HCP interrupt enabled
3
HF2
Host Flag 2
0
4
HF3
Host Flag 3
0
—
—
HPCR
0
HGEN
Host GPIO
0
GPIO signal disconnected
0
—
—
Enable
1
GPIO signals active
1
HA8EN
Host Address
0
HA8/A1 = GPIO
0
—
—
Line 8 Enable
1
HA8/A1 = HA8
2
HA9EN
Host Address
0
HA9/A2 = GPIO
0
—
—
Line 9 Enable
1
HA9/A2 = HA9
3
HCSEN
Host Chip Select
0
HCS/A10 = GPIO
0
—
—
Enable
1
HCS/A10 = HCS
DSP56311 User’s Manual, Rev. 2
Freescale Semiconductor
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